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专利号: 2019100919127
申请人: 西安理工大学
专利类型:发明专利
专利状态:已下证
专利领域: 计算;推算;计数
更新日期:2024-11-28
缴费截止日期: 暂无
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摘要:

权利要求书:

1.一种低功耗处理器系统,其特征在于,包括基准时钟(2),所述基准时钟(2)的一个输出端与移位计数器(1)的输入端相连,用以驱动移位计数器(1)运行,所述基准时钟(2)的另一个输出端与控制模块(3)的输入端连接,用以产生系统运行所需的时钟信号;

所述移位计数器(1)的输出端包括第0位输出端、第1位输出端、第2位输出端、第3位输出端,所述第0位输出端连接控制模块(3)的输入端,所述控制模块(3)的输出端连接或门电路(12)的输入端,所述或门电路(12)的输出端与无流水处理器(13)连接,所述移位计数器(1)通过或门电路(12)控制无流水处理器(13)常开,所述第1位输出端、第2位输出端、第3位输出端分别通过控制模块(3)与动态开关单元连接,所述动态开关单元与无流水处理器(13)连接,所述移位计数器(1)通过动态开关单元实现无流水处理器(13)动态开关;

所述第1位输出端、第2位输出端、第3位输出端还通过控制模块(3)直接与无流水处理器(13)连接。

2.如权利要求1所述的一种低功耗处理器系统,其特征在于,所述动态开关单元包括反相器(4)、门控供电单元(5),所述反相器(4)的输入端与控制模块的输出端(3)连接,所述反相器(4)的输出端与门控供电单元(5)连接,所述门控供电单元(5)与所述无流水处理器(13)连接。

3.如权利要求2所述的一种低功耗处理器系统,其特征在于,所述无流水处理器(13)内部逻辑电路包括第一执行相位、第二执行相位、第三执行相位、第四执行相位,所述第一执行相位的输出端与第二执行相位的输入端连接,所述第二执行相位的输出端与第三执行相位的输入端连接,所述第三执行相位的输出端与第一执行相位、第四执行相位的输入端连接,所述第四执行相位的输出端与第二执行相位的输入端连接。

4.如权利要求3所述的一种低功耗处理器系统,其特征在于,所述第一执行相位与第二执行相位之间连接有第一半定制数据保持单元、第二执行相位与第三执行相位之间连接有第二半定制数据保持单元、第三执行相位与第一执行相位、第四执行相位之间连接有第三半定制数据保持单元、第四执行相位与第二执行相位之间连接有第四半定制数据保持单元。

5.如权利要求4所述的一种低功耗处理器系统,其特征在于,所述第一半定制数据保持单元、第二半定制数据保持单元、第三半定制数据保持单元、第四半定制数据保持单元均包括三态门(10),三态门(10)的输出端连接保持单元(11)。

6.如权利要求5所述的一种低功耗处理器系统,其特征在于,所述第一执行相位的输出端连接所述第一半定制数据保持单元的三态门(10)的输入端,所述第一半定制数据保持单元的三态门(10)的输出端与所述第二执行相位的输入端连接,所述第二执行相位的输出端连接所述第二半定制数据保持单元的三态门(10)的输入端,所述第二半定制数据保持单元的三态门(10)的输出端与所述第三执行相位的输入端连接,所述第三执行相位的输出端连接所述第三半定制数据保持单元的三态门(10)的输入端,所述第三半定制数据保持单元的三态门(10)的输出端分别与第一执行相位的输入端和第四执行相位的输入端连接,所述第四执行相位的输出端连接所述第四半定制数据保持单元的三态门(10)的输入端,所述第四半定制数据保持单元的三态门(10)的输出端与第二执行相位的输入端连接。

7.如权利要求5所述的一种低功耗处理器系统,其特征在于,所述第0位输出端通过或门电路(12)与第一半定制数据保持单元的三态门(10)上的控制端连接,所述第1位输出端与第二半定制数据保持单元的三态门(10)上的控制端连接,所述第2位输出端与第三半定制数据保持单元的三态门(10)上的控制端连接,所述第3位输出端与第四半定制数据保持单元的三态门(10)上的控制端连接。

8.如权利要求5所述的一种低功耗处理器系统,其特征在于,所述第1位输出端依次通过反相器(4)和门控供电单元(5)与第二执行相位连接,所述第2位输出端依次通过反相器(4)和门控供电单元(5)与第三执行相位连接,所述第3位输出端依次通过反相器(4)和门控供电单元(5)与第四执行相位连接。