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专利号: 2020101874041
申请人: 重庆邮电大学
专利类型:发明专利
专利状态:已下证
专利领域: 电通信技术
更新日期:2024-02-23
缴费截止日期: 暂无
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摘要:

权利要求书:

1.一种基于FPGA的小区搜索粗同步的实现方法,其特征在于:该方法包括以下步骤:

S1:将接收的数据进行频谱搬移,频谱搬移用到了vivado软件的rotate IP核,得到频谱搬移后的数据;

S2:将接收到的频谱搬移后的数据进行FIR滤波,FIR滤波使用了vivado软件的FIR IP核;

S3:对滤波后的数据进行降采样,通过对输入数据的有效位进行计数,计数满16的时候,将输出有效位拉高;

S4:将降采样后数据进行归一化,归一化是将每32个数据比较出实部绝对值最大值和虚部绝对值中更大的值,将这32个数据除以最大值,得到归一化的数值;

S5:将前38656个数据存储在RAM中;

S6:将RAM中的数据与ROM中存储的本地生成序列进行互相关;

S7:通过冒泡的方式算得前30个最大值,以及计算互相关之和,用和减去前30个最大值;进一步算得峰均比;

S8:算得峰均比之后比较三组id的大小,如果3组id中最大的那组的最大值大于预设的标准值,则粗同步成功,并返回小区id号以及最大值的位置,否则粗同步失败。

2.根据权利要求1所述的一种基于FPGA的小区搜索粗同步的实现方法,其特征在于:所述步骤S4中,所述对降采样的数据进行归一化,具体包括将降采样的数据实部与虚部分开,将实部与虚部转换成绝对值进行比较,每32个数据为一组;与此同时用vivado软件的fifo IP核对数据进行缓存,每次存满了32个数据就输出32个数据,此时32个数据的绝对值最大值已经算出,那么将32个数据除以绝对值的最大值,则完成归一化。

3.根据权利要求1所述的一种基于FPGA的小区搜索粗同步的实现方法,其特征在于:所述步骤S5中,存储在RAM中的数据是逐一的存储在8个深度为4832的RAM中,在取RAM中的数据时,索引为0时,则取出8个RAM中的第0个数据;当索引为1时,则取出第1个RAM的第1个数据,第2到8个数据的第0个数据。

4.根据权利要求1所述的一种基于FPGA的小区搜索粗同步的实现方法,其特征在于:所述步骤S6中,互相关的本质是滑动窗的操作,将对应不同id号的3组本地生成序列分成8组储存在8个ROM中;使用乘法器将RAM中的数据与ROM的数据相乘;每256次乘积之和为一次滑动窗的结果。

5.根据权利要求1所述的一种基于FPGA的小区搜索粗同步的实现方法,其特征在于:所述步骤S7中,将每次滑动窗的结果进行累加,每次滑动窗的结果进入30级的流水线中,当进入的数据大于流水线寄存器中的数据时,则将进入的数据赋值给寄存器,而寄存器的数据送入下一级流水线;如果进入的数据小于流水线寄存器中的数据,则将进入的数据流入下一级流水线中,寄存器中的数据保持不变,得到30个最大值。